【導讀】O-RAN旨在推動(dòng)無(wú)線(xiàn)社區轉型、開(kāi)辟新無(wú)線(xiàn)設備通道和推動(dòng)創(chuàng )新，以履行3GPP關(guān)于5G的承諾。1要取得成功并保持高性?xún)r(jià)比，必須提供開(kāi)源的無(wú)線(xiàn)電設備和優(yōu)化的5G技術(shù)。本文將介紹其中一種用于設計和構建高功效比的解決方案。
5G帶來(lái)了哪些挑戰？
無(wú)線(xiàn)電和網(wǎng)絡(luò )工程師目前使用幾種技術(shù)來(lái)實(shí)現這些目標。除了將數據服務(wù)移動(dòng)到網(wǎng)絡(luò )終端之外，還使用大規模MIMO和小型蜂窩技術(shù)來(lái)幫助提高容量和吞吐量。大規模MIMO技術(shù)在陣列中使用多個(gè)無(wú)線(xiàn)電，此舉不僅可以實(shí)現容量，還可以覆蓋中心位置。和它的前身宏蜂窩一樣，大規模MIMO無(wú)線(xiàn)電可以圍繞該位置提供相對廣泛的覆蓋范圍。但是，大規模MIMO無(wú)線(xiàn)電使用更高的頻率，一般是2.6 GHz及以上，這個(gè)頻率對建筑物的穿透性并不高。為了服務(wù)室內位置和其他難以到達的室外區域，我們將使用小型蜂窩。鑒于室內和室外位置的數量，從家庭到企業(yè)安裝，再到消費購物場(chǎng)所乃至競技場(chǎng)，小型蜂窩的使用將是5G取得成功的關(guān)鍵。由于網(wǎng)絡(luò )中需要使用數量龐大的小型蜂窩和多種部署，所以安裝和運行成本必須低廉；這是推動(dòng)實(shí)現5G的關(guān)鍵。
可以使用哪些技術(shù)？
在過(guò)去幾年里，多種技術(shù)朝著(zhù)支持5G解決方案的方向發(fā)展。首先，從基帶角度來(lái)看，摩爾定律不僅繼續降低每個(gè)柵極的硅成本，而且將更復雜的功能集成到無(wú)線(xiàn)電技術(shù)中?，F在可以將許多所需的控制算法直接集成到無(wú)線(xiàn)電設備中，包括數字預失真(DPD)等功能。隨著(zhù)新生代無(wú)線(xiàn)電設備的問(wèn)世，出現了許多其他的可能性。
其次，像O-RAN2這樣的行業(yè)聯(lián)盟正在整個(gè)無(wú)線(xiàn)行業(yè)進(jìn)行合作，以實(shí)現規模經(jīng)濟，不僅可以降低成本，還可以提高供應鏈的安全性，并提供通過(guò)這些無(wú)線(xiàn)網(wǎng)絡(luò )盈利的新方法。具體來(lái)說(shuō)，"O-RAN聯(lián)盟是由運營(yíng)商建立的，旨在明確定義要求，并幫助建立供應鏈生態(tài)系統來(lái)實(shí)現其目標。為了實(shí)現這些目標，O-RAN聯(lián) 盟的工作奉行"開(kāi)放和智慧的原則"。3因此，他們側重于定義3GPP指定的物理接口，以實(shí)現標準化，并在行業(yè)中作為可互操作的白盒解決方案使用。此外，O-RAN還定義了硬件要求，并提供了O-CU、O-DU和O-RU（分別表示開(kāi)放式集中單元、開(kāi)放式分配單元和開(kāi)放式無(wú)線(xiàn)電單元）的參考設計。它們會(huì )使前傳網(wǎng)路和基帶處理器實(shí)現標準化，進(jìn)一步降低解決方案成本。它們與其他集成式5G設備（例如集成式無(wú)線(xiàn)電）一起，可用于定義小型蜂窩的發(fā)展，并推動(dòng)實(shí)施這些標準。這些機構的工作是非常關(guān)鍵的一步。
第三，無(wú)線(xiàn)電技術(shù)在過(guò)去幾年中得到迅速發(fā)展。高性能無(wú)線(xiàn)電現在有多種架構，可以滿(mǎn)足3GPP在38.104和相關(guān)文檔中要求的性能標準。1這些無(wú)線(xiàn)電高度集成，不僅包含模擬和RF元件，還包括DPD和削峰(CFR)等關(guān)鍵算法。雖然這些無(wú)線(xiàn)電是基于細線(xiàn)CMOS構建的，但RF前端也在經(jīng)歷其他發(fā)展，其中，低成本RF工藝（SiGe、SOI、GaN、GaAs等）正轉變?yōu)楦叨燃傻腖NA和高功率、高性能的PA，可以滿(mǎn)足這些標準的要求。
最后，提供高度集成和節能的解決方案，包括以太網(wǎng)供電(PoE)、標準電源設備、監控和保護解決方案，它們尺寸緊湊，但可以提供所需的電源。這些解決方案在無(wú)線(xiàn)電環(huán)境中提供非常高的效率和非常低的噪聲，且提供選項，用于保護關(guān)鍵設備，例如功率放大器。
這些技術(shù)結合在一起，實(shí)現了低成本、高性能的小型蜂窩平臺，可以高效部署在運營(yíng)商網(wǎng)絡(luò )中，以支持小功率和大功率系統。
系統概述
圖1顯示了典型的4T4R（4個(gè)發(fā)射器和4個(gè)接收器）5G小型蜂窩的框圖?？梢圆捎枚喾N排列，包括2T2R和一系列功率等級（從24 dBm和更高）。后續討論以此圖為基礎，主要介紹可以輕松擴展，適應O-RU中的頻段和功率變化的5G技術(shù)設備。
圖1. 小型蜂窩功能框圖。
主要無(wú)線(xiàn)電元件
在過(guò)去10年，集成式收發(fā)器已發(fā)展成為高性能平臺。 ADI RadioVerse? 系列包含多種集成式收發(fā)器，它們支持高達200 MHz占用帶寬，集成了DPD等先進(jìn)功能。該系列產(chǎn)品不僅滿(mǎn)足5G技術(shù)設備的要求，也一如既往地支持LTE和多載波GSM RF要求。對于這些設備，雖然我們在不斷進(jìn)行新一代的開(kāi)發(fā)，最新一代如圖2所示，為 ADRV9029，是一種4T4R配置。還提供其他產(chǎn)品，包括帶和不帶集成式DPD，以及采用包括2T2R在內的其他配置的設備。
圖2. ADRV9029收發(fā)器。
每款RadioVerse設備都包含構建完整無(wú)線(xiàn)電所需的一切（LNA和PA除外）。這包括發(fā)送和接收、合成器和時(shí)鐘等所有功能。還包括運行AGC和增益控制放大器所需的狀態(tài)機和VGA。雖然RadioVerse產(chǎn)品都使用高達6 GHz的寬帶，但LNA和PA并非如此，必須制定頻段或頻率范圍。因此，為了完成無(wú)線(xiàn)電設計，必須將合適的LNA和PA與RadioVerse IC配對。以下章節將描述5G NR小型蜂窩的接收和發(fā)送信號鏈，并對如何選擇這些設備提供一些見(jiàn)解。
接收器信號鏈示例
ADRV9029與 ADRF5545A 組合使用時(shí)（如圖3所示），可以輕松構建2芯片接收器。 ADRF5515 引腳兼容，也可以使用。它與幾個(gè)無(wú)源元件組合，就可以構成非常緊湊的高性能接收器設計，如圖4中的信號鏈所示。此架構的關(guān)鍵優(yōu)勢在于可能達到高水平集成，如此不但可以實(shí)現極低的實(shí)施成本，還能使功耗降至最低。4
圖3. ADRF5545A雙通道TDD接收器前端。
圖4. 接收器信號鏈詳情。
RadioVerse系列的架構取消了經(jīng)典接收器設計中常使用的許多元件，包括一些RF放大、濾波和剩余大部分無(wú)線(xiàn)電功能的集成，包括通道濾波器（模擬和數字）和基帶放大器。這些元件通常是系統中最大、功率最高的設備，相比包括直接RF采樣在內的其他架構，此架構可以顯著(zhù)節省成本。
如圖4所示，小型蜂窩接收器系列包括環(huán)形器（適用于TDD應用）、ADRF5545A、SAW/BAW（表面聲波/體聲波）或整體式濾波器、巴倫和收發(fā)器。鑒于A(yíng)DRV9029和RadioVerse系列中的其他產(chǎn)品具有出色的噪聲性能和低輸入IP1dB，所以無(wú)需使用其他放大器或VGA。使用這個(gè)信號鏈之后，從天線(xiàn)到數據比特位，可以支持整個(gè)系統低至2 dB的噪聲系數。雖然此設計中包含一個(gè)集成式RF前端模塊(FEM)，但許多設計仍然使用分立式設計（此處不予詳述）。集成式FEM利用集成來(lái)滿(mǎn)足天線(xiàn)濾波器稍微提高的濾波器要求，但仍然提供對于許多高度集成的解決方案來(lái)說(shuō)具有吸引力的設計，例如大規模MIMO和其他TDD部署。通常，使用分立式前端來(lái)實(shí)現FDD設計。
假設LNA之前的耗損為約0.5 dB，如果帶濾波器的耗損為1 dB，根據兩款有源設備的數據手冊規格，則整個(gè)接收器信號鏈的標稱(chēng)NF應為約2 dB。假設與MCS-4一致的信噪比和信納比為0 dB，那么G-FR1-A1-1 5G載波(~5 MHz)的參考靈敏度為約–104.3 dBm。這足以滿(mǎn)足章節7.2.2中38.104的廣域傳導要求，且留有余量，對局域/小型蜂窩來(lái)說(shuō)也綽綽有余，如表1所示，在這種情況下需要–93.7 dBm。一些低性能小型蜂窩應用可能能夠使用單級LNA，例如GRF2093，后接一個(gè)SAW濾波器。
表1. 38.104接收器分類(lèi)
此外，38.104章節的7.4.1要求在低于–52 dBm（廣域）ACS阻塞下，接收器的衰減不超過(guò)6 dB。根據圖5所示的NF與輸入電平，在–52 dBm時(shí)產(chǎn)生的額外噪聲并不比在更低電平下產(chǎn)生的噪聲多。事實(shí)上，本底噪聲在Blocker信號達到–40 dBm后才會(huì )上升，非常適合需要–44 dBm容差的局域ACS。
圖5. 接收器NF與輸入電平。
一般阻塞要求(7.4.2)要求對相關(guān)頻段內的接收器施加–35 dBm（局域）的干擾，偏移為±7.5 MHz，衰減不得超過(guò)6 dB。從圖5顯示的ADI公司的信號鏈的性能來(lái)看，衰減僅為約0.9 dB。窄帶阻塞是一種功率稍低的CW類(lèi)阻塞，但這也不是問(wèn)題。
章節7.5.2中的帶外阻塞可能算是一種更為有趣的挑戰。其中，–15 dBm信號被傳輸至天線(xiàn)輸入。對于頻率低于200 MHz的小型蜂窩，此信號最接近頻帶邊緣的頻率為20 MHz。測試要求對1 MHz至12.75 GHz范圍進(jìn)行掃描，不包括20 MHz工作頻率以?xún)鹊念l段。這里，有幾個(gè)因素會(huì )推動(dòng)信號鏈產(chǎn)生優(yōu)勢。第一，環(huán)形器具有有限帶寬，會(huì )拒絕許多帶外信號，但包含在內的信號不會(huì )產(chǎn)生很大影響。第二，ADRF5545A之后的濾波器會(huì )提供一定程度的濾波，一般來(lái)說(shuō)，對于帶外20 MHz，~20 dB抑制是合理的。第三，ADI收發(fā)器系列獨有且最有用的特性要屬內置的帶外抑制，這是收發(fā)器結構固有的特性。在A(yíng)DI公司應用筆記 AN-1354的圖20中，固有的帶外抑制被表示為增加的阻塞信號電平。在該應用筆記中，圍繞通帶任一方向的頻率掃描顯示，在相同等級的衰減下，可以支持更大的信號。在該應用筆記中可以看到，在靠近頻帶邊緣的位置，6 dB衰減可以對應10 dB。之后，集成式濾波器對帶外信號進(jìn)行大幅衰減，這些信號不會(huì )在帶內混疊，主要被片內濾波和外部濾波衰減。
這些模塊將–15 dBm帶外干擾濾波到約–40 dBm至–45 dBm，直到20 MHz排斥帶。繼續向前，可能受到更高的抑制。在這個(gè)階段，圖5顯示出現的衰減可能非常小。
前端模塊的線(xiàn)性度可能是更大的問(wèn)題。此時(shí)，可能得出很大的IM3產(chǎn)物。根據實(shí)際選擇的FEM，可能需要將頻帶選擇濾波器移動(dòng)到第二個(gè)LNA之前，以保護其不受帶外信號影響，這通常會(huì )產(chǎn)生較大的IM產(chǎn)物。無(wú)法在這類(lèi)FEM的級之間放置濾波器，所以需要采用備用選項。
為了幫助限制大型帶外阻斷器的互調的影響，典型的FEM包含二級旁路開(kāi)關(guān)，用于降低增益和保護二級不會(huì )被驅動(dòng)產(chǎn)生非線(xiàn)性，如圖3所示。切換LNA增益使信號鏈SNR降低1 dB，但限制這些大型阻斷器引起的交調失真有助于保護整體動(dòng)態(tài)范圍，抵消噪聲性能的損失?？傮w而言，如此產(chǎn)生的最差NF為約5.7 dB，這仍然在參考靈敏度的局域（小型蜂窩）覆蓋范圍要求之內。剩余的濾波器要求由天線(xiàn)濾波器提供，抑制可以根據接收器FEM的低增益壓縮點(diǎn)和IP3決定。
變送器信號鏈示例
將ADRV9029和合適的RF驅動(dòng)放大器，或RFVGA組合使用時(shí)（訪(fǎng)問(wèn) analog.com/rf 了解更多選項），可以輕松構建合適的PA、緊湊的室內微微蜂窩、室外微微蜂窩或室外微蜂窩5。這些5G技術(shù)設備與幾個(gè)無(wú)源元件組合，就可以構成非常緊湊且高效的變送器設計，如圖6中的信號鏈所示。此架構的關(guān)鍵優(yōu)勢在于可能達到的高水平集成，通過(guò)使用所選的ADI收發(fā)器具備的集成式DPD功能，不但可以實(shí)現極低的實(shí)施成本，還能使功耗降至最低。
圖6. 變送器信號鏈詳情。
如圖6所示，小型蜂窩變送器系列由環(huán)形器、PA、濾波器和收發(fā)器組成。此外，電路的PA輸出端中包含一個(gè)耦合器，用于監測輸出失真（也可以用于監測天線(xiàn)的VSWR和正向功率），可以配合DPD使用，以改善發(fā)送功能的運行效率，以及改善雜散性能。雖然可以使用外部DPD，但選擇的ADI收發(fā)器包含完全集成的DPD，該DPD采用350 mW或更低的增量功率，具體由給定的PA所需的校正量決定。低功率PA需要進(jìn)行的校正較少，所以DPD消耗的功率更低。此外，由于DPD的帶寬擴展完全在收發(fā)器內部進(jìn)行，觀(guān)察接收器SERDES路徑被完全取消，變送器有效載荷降低，使得集成式DPD將SERDES路徑的數量降低至外部基帶芯片的一半。FPGA中的等效DPD通常具有10倍以上的功率，對于低功耗小型蜂窩和大規模MIMO來(lái)說(shuō)是無(wú)效或低效的。但是，通過(guò)將DPD集成到收發(fā)器中，非常低的功耗和低成本使得DPD能被用于低功耗小型蜂窩中，可以在不增加外部計算負擔的情況下提高效率和變送線(xiàn)性度。
圖7和圖8顯示ADI的DPD用于低功耗和中功耗小型蜂窩應用的示例。圖示的激勵源是針對5個(gè)相鄰的20 MHz LTE載波，總共100 MHz。一般來(lái)說(shuō)，LTE要求最低達到45 dB ACLR，大多數部署都可以超過(guò)此值。ADI運行一個(gè)連續測試實(shí)驗室，始終會(huì )檢查所有功率等級的新PA。查看 功率放大器測試報告，或咨詢(xún)工廠(chǎng)，獲取ADI提供的可用的DPD技術(shù)的最新信息，以及最近通過(guò)測試的PA的列表。
圖7. 帶和不帶DPD的典型PA頻譜，RF總和為26 dBm。
圖8. 帶和不帶DPD的典型PA頻譜，RF總和為37 dBm。
它們如何組合使用？
圖9顯示完整的信號鏈，其中包括一些所需的控制信號。為了提高功效，該電路包含變送和接收信號功能，以在各自的周期內為T(mén)DD啟用和禁用放大器。同樣，它可與FDD配合使用，在插槽未使用時(shí)關(guān)斷電源，以節省功率。還需要使用LNA開(kāi)關(guān)來(lái)更改LNA上的輸入開(kāi)關(guān)，以將返回的變送功率分流至端電極，而不是分流至內核放大器輸入。這些不同的信號可以由ASIC、FPGA或收發(fā)器生成和編配。
圖9. 完整的收發(fā)器信號鏈。
接收器信號鏈包括一個(gè)可以相應改變數字數據流的函數，以說(shuō)明模擬增益降低的原因，在信號發(fā)送至低PHY，然后發(fā)送至基帶下游其他部分時(shí)保持絕對信號電平。
此處所示的應用適用于單頻段。雖然收發(fā)器使用寬帶且覆蓋至高達6 GHz的所有頻率，但并非設計中的所有設備都是如此。LNA和PA這類(lèi)設備通常使用頻段，需要根據支持的頻段進(jìn)行選擇。通常情況下，這些設備在引腳兼容選項中提供，覆蓋6 GHz以下的所有常用頻段，且易于掃描。如此，可以支持所有的常用TDD和FDD頻段，包括用于5G和提議用于O-RAN的頻段。
時(shí)鐘樹(shù)
根據配置，可以使用幾種不同的時(shí)鐘配置。如果需要精確的時(shí)間校準，則需要使用2級時(shí)鐘合成。第一級是通過(guò)ASIC、FPGA或控制器連接至基帶，以準確計時(shí)和校準無(wú)線(xiàn)電數字化功能。此應用要求通過(guò)前傳網(wǎng)路或本地GPS接收器來(lái)處理提供的精確時(shí)間協(xié)議(PTP)信息。如此確保無(wú)線(xiàn)電和基帶處理器知道應對無(wú)線(xiàn)電幀實(shí)施處理的準確時(shí)間。
AD9545 系列非常適合用于準確調節無(wú)線(xiàn)電的主時(shí)鐘的頻率、相位和時(shí)間。其優(yōu)點(diǎn)在于，可以配置為在無(wú)參考時(shí)鐘的情況下臨時(shí)運行，且在與TCXO（溫度補償晶體振蕩器）或OCXO（恒溫晶體振蕩器）耦合之后，且在參考時(shí)鐘出現故障或斷續的情況下保持精度。
對于無(wú)需準確的時(shí)間校準的配置，或者作為校準的第二級，需要使用時(shí)鐘分配設備。分配設備的作用在于，為整個(gè)無(wú)線(xiàn)電生成時(shí)鐘范圍。這包括JESD、eCPRI、以太網(wǎng)、SFP所需的范圍，以及整個(gè)無(wú)線(xiàn)電的其他關(guān)鍵信號所需的范圍。 AD9528 提供14種不同速率的低抖動(dòng)時(shí)鐘，包括支持JESD204B/JESD204C設備時(shí)鐘和SYSREF信號功能。
2級時(shí)鐘框圖如圖10所示。對于無(wú)需準確校準時(shí)間的應用，可以去掉或旁路AD9545，僅使用AD9528。系統的輸入時(shí)鐘來(lái)自于基本的網(wǎng)絡(luò )定時(shí)，由以太網(wǎng)功能塊或FPGA中的基帶和網(wǎng)絡(luò )功能恢復，具體由實(shí)際架構決定?？梢愿鶕o(wú)線(xiàn)電的具體要求選擇多種備用配置，此處只顯示一種表示方法。
圖10. 時(shí)鐘樹(shù)示例。
功率
功耗是由多種因素決定的。這些因素包括選擇的FPGA、采用的功能、選擇的收發(fā)器、啟用的選項、所需的時(shí)鐘樹(shù)，以及生成的RF功率。
實(shí)施O-RAN CUS和M面處理的典型中等范圍FPGA SoC，加上與IEEE 1588 v2 PTP堆棧同步，會(huì )消耗約15 W。典型的ADRV9029收發(fā)器會(huì )消耗5 W至8 W，由TDD或FDD配置，以及啟用的DFE功能的范圍決定。為此，必須增加時(shí)鐘功率、接收器功率、變送器功率，以及其他功率。表2顯示系統（不包括變送器鏈）的功耗總和示例，功率輸出等級不同時(shí)，該值存在很大差異。
表2. 預算功耗
將無(wú)線(xiàn)電的功耗相加，Tx:Rx在70:30占空比下的總功耗為26 W至29 W，具體由實(shí)際采用的無(wú)線(xiàn)電配置決定（不包括與PA相關(guān)的功耗）。表3顯示少數幾個(gè)PA功耗示例。由于PA主要在A(yíng)B類(lèi)晶體管的線(xiàn)性范圍內工作，所以它們的效率在20%到50%之間。在這個(gè)范圍內，集成式DPD大有優(yōu)勢。即使對于小帶寬、低功耗PA，幾十mW的DPD功耗也會(huì )抵消PA效率的改進(jìn)。
表3. 變送功耗
對于低功耗小型蜂窩，增加約2.5 W額外功率會(huì )讓總功耗增加至約30 W，對于由PoE解決方案供電的無(wú)源冷卻室內小型蜂窩非常合適。
一種潛在的PoE解決方案如圖11所示。該解決方案包括 LT4321 橋控制器，它使得MOS晶體管可以用作理想的二極管，而不是整流器，其優(yōu)點(diǎn)在于可以大幅提高效率。其后接 LT4295，這是一個(gè)符合802.3bt標準的PD設備。還可以后接合適的本地穩壓器，以滿(mǎn)足之前的表中所示的要求，按照需要提供高達90+ W的功率。
圖11. PoE隔離式小型蜂窩電源解決方案。
除了PoE轉換設備外，還可以使用許多其他設備來(lái)支持小型蜂窩參考設計。其中包括基礎設備，例如 ADP5054 系列，該系列專(zhuān)用于為ADI收發(fā)器、許多其他降壓轉換器和低噪聲LDO穩壓器供電，如圖12所示。
圖12. 適用于小型蜂窩應用的典型功率樹(shù)。
選項
這個(gè)無(wú)線(xiàn)電架構的一大優(yōu)點(diǎn)是：它非常靈活，可以滿(mǎn)足多種市場(chǎng)需求。此架構針對多種應用進(jìn)行優(yōu)化，包括FDD和TDD。它可以在低、中和高頻段內保持高性能，非常適合小型蜂窩到大規模MIMO平臺?？梢栽谧兯推骱徒邮掌麟娐分羞M(jìn)行不同的權衡取舍，以?xún)?yōu)化成本、尺寸、重量和功率。雖然本部分側重于更高的性能和集成，但可以通過(guò)選擇稍微不同的選項，做出可以改善成本的取舍。
例如，一些低功耗PA不需要使用驅動(dòng)放大器，可以不要求配備。對于許多小型蜂窩應用來(lái)說(shuō)，RF功率都較低，所以可以使用簡(jiǎn)單的TR開(kāi)關(guān)來(lái)替代環(huán)形器。最后，如果只需要局域性能，可以使用簡(jiǎn)單的單級LNA來(lái)替換雙級LNA。結果是，成本更低的選項仍然能夠提供不錯的無(wú)線(xiàn)電性能。實(shí)例如圖13所示。還可以使用許多其他排列，在廣泛的頻率和功率選項內，滿(mǎn)足多種可能。
圖13. 備用的收發(fā)器信號鏈。
結論
本文所述的5G技術(shù)設備適用于通信應用，支持實(shí)現適合5G開(kāi)發(fā)的低成本設備，尤其是實(shí)現O-RAN O-RU解決方案的設備。其中包括來(lái)自RadioVerse系列的設備、RF放大器、時(shí)鐘恢復/同步，以及以太網(wǎng)供電/負載點(diǎn)調節。這些高度集成的設備組合可用于實(shí)現5G小型蜂窩、宏蜂窩、微蜂窩和大規模MIMO應用。
圖14. 5G原型平臺，包括可重新選擇頻段的RF前端。
與FPGA、eASIC或ASIC中提供的合適的PHY和軟件組合使用時(shí)，可以開(kāi)發(fā)完整的O-RU解決方案，如圖14所示。此解決方案是與Intel?、Comcores和 Whizz Systems等合作伙伴共同開(kāi)發(fā)的。這些解決方案不僅滿(mǎn)足所需的RF特性，而且滿(mǎn)足部署低成本、高性能O-RAN平臺所需的成本和功率預算。
參考電路
1 ftp://ftp.3gpp.org/specs/latest/Rel-15/38_series/
2 O-RAN聯(lián)盟。
3 “O-RAN：朝向開(kāi)放和智能的RAN發(fā)展”。O-RAN聯(lián)盟，2018年10月。
4 Brad Brannon. “零中頻的優(yōu)勢：PCB尺寸減小50%，成本降低三分之一”。 《模擬對話(huà)》，第50卷第3期，2016年9月。
5 規格。O-RAN聯(lián)盟。
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