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隔離飛電容多電平變換器的硬件設計

發(fā)布時(shí)間:2024-11-23 責任編輯:lina

【導讀】為了確保在指定的 40 V 輸出上進(jìn)行安全可靠的測試,選擇組件時(shí)要考慮各種操作。為了實(shí)現更大的電壓測試,并展示飛跨電容器多電平轉換器 (FCMFC) 如何利用與反激式轉換器相同的組件更有效地執行, 本研究中未使用飛跨電容器結構帶來(lái)的較低額定電壓。這表明后續幾代產(chǎn)品將通過(guò)使用 額定值較低的半導體進(jìn)一步提高效率。


為了確保在指定的 40 V 輸出上進(jìn)行安全可靠的測試,選擇組件時(shí)要考慮各種操作。為了實(shí)現更大的電壓測試,并展示飛跨電容器多電平轉換器 (FCMFC) 如何利用與反激式轉換器相同的組件更有效地執行, 本研究中未使用飛跨電容器結構帶來(lái)的較低額定電壓。這表明后續幾代產(chǎn)品將通過(guò)使用 額定值較低的半導體進(jìn)一步提高效率。

為了測試前面提到的工作原理,使用相同的組件創(chuàng )建了三個(gè)硬件原型,如表 1 所示。將使用反激轉換器作為基準對這兩個(gè) FCMFC 進(jìn)行比較。反激式配置被視為 N2 FCMFC。開(kāi)發(fā)的 N3 和 N4 轉換器在次級分別包含 2 個(gè)和 3 個(gè)電容器級。


隔離飛電容多電平變換器的硬件設計


控制傳感

初級 FET 的相移脈沖寬度調制 (PSPWM) 控制信號和轉換器次級上飛跨電容器的浮動(dòng) FET 信號由 Texas Instruments C2000 F28335 Delfino 控制開(kāi)發(fā)板發(fā)送。該板由 PLEC 的編碼器編程。初級 FET 設置了軟啟動(dòng)功能,可緩慢開(kāi)啟雙繞電感,避免因輸出電容未充電而產(chǎn)生高浪涌電流。該計劃可防止磁飽和并保護使用額定電壓較低的 FET 的未來(lái)版本。每次測試試驗都使用開(kāi)環(huán)控制以固定占空比運行 FET。

隔離輔助電源、浮柵驅動(dòng)、自舉

晶體管源極節點(diǎn)處的浮動(dòng)電壓是多級結構中的一個(gè)問(wèn)題。對于 FCMFC,由于需要保持初級和次級電路電氣隔離,這個(gè)問(wèn)題變得更加嚴重。幸運的是,FCMFC 不需要先進(jìn)的引導技術(shù)。選擇 Analog Devices 的 LTM8067 隔離電源芯片來(lái)為自舉電路提供額外的電源。該芯片被設置為將 5 V 電源升壓至 8 V 并驅動(dòng)次級側的 MOSFET。

該芯片是反激式轉換器,因此它保持主轉換器的初級到次級隔離,額定電壓為 2 kV。它具有一個(gè)電壓輸出,如果需要,可以使用電阻器進(jìn)行調節,以在更高的電壓下驅動(dòng) FET。對于這項工作,英飛凌 FET 可以使用 8 V 和 12 V 電壓,該 FET 只能處理 20 V 柵極驅動(dòng)。為了獲得良好的電壓調節,輸入和輸出處的電容分別為 2 F 和 30 F。

一個(gè) 20 m 的電阻器與輔助轉換器的輸入串聯(lián),以防止電源電感和輸入電容之間可能出現諧振回路。通過(guò)選擇 Texas Instruments UCC21220A 隔離柵極驅動(dòng)器芯片,將浮動(dòng)電壓節點(diǎn)用作虛擬地。它們還在邏輯電平控制器輸入側和驅動(dòng)飛跨電容器 MOSFET 的次級高壓側之間提供 4 kV 隔離。

每個(gè)浮動(dòng)電壓節點(diǎn)都需要一個(gè)自舉,這與飛跨電容器相同。 N3 FCMFC 有一個(gè)自舉電路,而 N4 轉換器有兩個(gè)。每個(gè)自舉電路由電阻器(RB)、二極管(DB)和電容器(CB)組成。隔離的 8 V DC 電源為電阻器供電,該電阻器與二極管串聯(lián),然后與電容器串聯(lián)。然后,該電容器連接到浮動(dòng)源極節點(diǎn),該節點(diǎn)是飛跨電容器 C1 的負極。這在自舉電路圖的圖 1 中用紅點(diǎn)表示。


隔離飛電容多電平變換器的硬件設計圖 1 . N3 的自舉電路。圖片由IEEE Open Journal of Power Electronics提供


CB 的正極性連接到隔離驅動(dòng)芯片的輸入電壓節點(diǎn)。在此設置中,自舉電路使用隔離電源對變壓器的第二個(gè)接地進(jìn)行充電,并且 FC 網(wǎng)絡(luò )的所有后一個(gè)開(kāi)關(guān)均打開(kāi)。當后一個(gè)開(kāi)關(guān)關(guān)閉時(shí),CB 兩端的電壓現在為 Viso - VDB + VC1。這使得浮動(dòng) FET 柵極到源極之間的電壓等于隔離電源的電壓減去自舉二極管兩端的壓降。

自舉電容器足夠大,可以快速充電并存儲足夠的能量,以保持 FET 每個(gè)周期所需的導通時(shí)間。對于更別的轉換器,例如本研究中的 N4,個(gè)自舉電容器(靠近線(xiàn)圈)將必須通過(guò)多個(gè) FET 充電。需要設置 PSPWM,以便自舉電容器有足夠的時(shí)間充電。當改變開(kāi)關(guān)頻率時(shí),就像在這項工作中一樣,自舉電路的充電和放電時(shí)間必須平衡。

所選自舉二極管的反向恢復時(shí)間為 3.7 ns,小于 FET 的有效導通時(shí)間。這樣做是為了防止電流過(guò)大而損壞輔助電源。 FET 的有效導通時(shí)間包括柵極充電后漏極至源極電壓下降所需的時(shí)間以及柵極電壓開(kāi)始時(shí)漏極至源極電壓開(kāi)始下降所需的時(shí)間上升。

選擇自舉二極管是為了在電容器充電時(shí)處理平均電流,這種情況發(fā)生在初級占空比(50%)時(shí)。二極管可以處理啟動(dòng)期間的峰值電流,即電源電壓減去二極管的壓降除以自舉電阻,約為 2A。

印刷電路板布局和電容器設計

在圖 2 中,三個(gè)轉換器的輸入位于左側,輸出位于右側。三個(gè)轉換器均位于一塊 4 層 PCB 上。從上到下分別是N4、N3、N2(反激式)。黃線(xiàn)是 14 AWG 電流跳線(xiàn),用于測量初級和次級電流的電流互感器測試探頭。三個(gè)轉換器之間沒(méi)有電氣連接。每個(gè)有源器件都有用于緩沖電路的 RC 焊盤(pán)。根據分析,飛跨電容器和輸出電容器選擇在 20-30 F 之間,以獲得 2.5% 的紋波。添加了更多焊盤(pán)(1 F 和 10 F),以根據設備的工作情況和實(shí)驗來(lái)微調電容。


隔離飛電容多電平變換器的硬件設計圖2 .印刷電路板 N2(底部)、N3(中)和 N4(頂部)。圖片由IEEE Open Journal of Power Electronics提供


緩沖電路

初級 FET 中有兩個(gè)緩沖電路。齊納緩沖器電路阻止開(kāi)關(guān)節點(diǎn)處的電壓過(guò)高,該電壓由于關(guān)斷時(shí)存在漏感能量而增加。為了保護 FET,齊納二極管設置為 27V。圖 3 顯示,齊納鉗位將電壓降至 32.03V,然后穩定在穩壓電壓(遠低于 100V FET 額定值)。電壓刻度為 5 V/p,時(shí)間刻度為 2 s/p。初級 FET 和其他有源器件具有串聯(lián) RC 緩沖器,以減少電壓振鈴。它們可以在很寬的頻率范圍內的所有情況下工作。例如,圖 3 在 500 kHz 時(shí)幾乎沒(méi)有可見(jiàn)的振鈴。


隔離飛電容多電平變換器的硬件設計圖3 .帶齊納緩沖器鉗位的初級 FET 開(kāi)關(guān)節點(diǎn)電壓。圖片由IEEE Open Journal of Power Electronics提供


隔離飛跨電容多電平轉換器硬件設計要點(diǎn)

本文討論了隔離飛跨電容多電平轉換器的硬件設計。以下是一些要點(diǎn)。

該研究提供了有關(guān)硬件設計和組件選擇的詳細信息,包括緩沖電路和微調電容的使用。

原型設計旨在確保在指定的 40 V 輸出上進(jìn)行安全可靠的測試,同時(shí)考慮到各種操作。

本研究并未利用飛跨電容器結構實(shí)現的較低額定電壓來(lái)實(shí)現更安全的測試,但未來(lái)幾代人可以使用較低額定值的半導體來(lái)提高效率。

與傳統轉換器相比,隔離飛跨電容器多電平轉換器具有提高效率和降低額定電壓的潛力,使其成為電力電子應用的有前途的替代品。

本研究開(kāi)發(fā)的 N3 和 N4 轉換器在次級分別包含 2 個(gè)和 3 個(gè)電容器級,展示了通過(guò)使用飛跨電容器結構提高效率的潛力。


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