
新款100G以太網(wǎng)和Interlaken IP內核,
推動(dòng)大容量傳輸和骨干網(wǎng)應用
發(fā)布時(shí)間:2013-11-21 來(lái)源:Altera 責任編輯:xueqi
【導讀】Altera近日發(fā)布新款100G以太網(wǎng)和Interlaken IP內核,推動(dòng)大容量傳輸和骨干網(wǎng)應用。最新內核實(shí)現了最佳性能、最低延時(shí)和最少資源占用,進(jìn)一步增強了公司同類(lèi)最佳的IP系列產(chǎn)品。
Altera公司(NASDAQ: ALTR)今天宣布,公司MegaCore IP庫新增四款同類(lèi)最佳的知識產(chǎn)權(IP)內核,進(jìn)一步增強了IP內核系列產(chǎn)品。這些同類(lèi)最佳的新IP內核包括超高性能和超低延時(shí)100G Interlaken、100G以太網(wǎng)、40G以太網(wǎng)和10G以太網(wǎng)IP。內核經(jīng)過(guò)優(yōu)化,實(shí)現了業(yè)界最佳性能、最低延時(shí)和最少資源占用。數據中心和網(wǎng)絡(luò )設備開(kāi)發(fā)人員可以利用這些通用解決方案來(lái)提高系統帶寬,同時(shí)突出最終系統的優(yōu)勢?,F在可以提供Interlaken和以太網(wǎng)IP內核以及其他標準接口IP,最新版Quartus II軟件v13.1為其提供全面支持。

圖1:Altera新款100G以太網(wǎng)和Interlaken IP內核
Altera的IP設計副總裁David Kehlet評論說(shuō):“我們關(guān)注創(chuàng )新,打破了傳統的設計壁壘,同時(shí)降低了延時(shí),提高了性能,減少了資源占用,為高性能IP內核設計設立了最佳實(shí)踐的新標準。從此,隨著(zhù)我們不斷發(fā)布重新設計的IP內核,這些最佳實(shí)踐還會(huì )繼續呈現給我們的客戶(hù)。”
MegaCore IP庫的所有IP都經(jīng)過(guò)了驗證,并在硅片中進(jìn)行了演示。IP內核時(shí)序余量增加了15%,更快的達到時(shí)序收斂,支持客戶(hù)更迅速的將多個(gè)IP內核集成到設計中。新的Interlaken和以太網(wǎng)IP內核經(jīng)過(guò)優(yōu)化,更適合應用在A(yíng)ltera高性能Stratix V FPGA以及未來(lái)的10代FPGA和SoC中??蛻?hù)目前可以通過(guò)早期軟件試用計劃,在20 nm Arria 10 FPGA中使用這些同類(lèi)最佳的IP內核。MegaCore IP庫中的新IP內核包括:
●低延時(shí)100G Interlaken IP內核——這一同類(lèi)最佳的IP內核采用了軟核PCS,其往返延時(shí)不到200ns。
●低延時(shí)100G以太網(wǎng)IP內核——這一同類(lèi)最佳的IP內核是最小的100G以太網(wǎng)內核,比現有100G以太網(wǎng)IP內核小55%,往返延時(shí)不到160ns,延時(shí)比競爭100G以太網(wǎng)IP內核低70%,這些指標都在業(yè)界領(lǐng)先。
●低延時(shí)40G以太網(wǎng)IP內核——比現有40G以太網(wǎng)IP內核小40%,延時(shí)低60%。
●低延時(shí)10G以太網(wǎng)IP內核——比現有10G以太網(wǎng)IP內核小20%,延時(shí)低24%。
關(guān)于Quartus II軟件v13.1版所有新的和增強IP內核的詳細信息,請訪(fǎng)問(wèn)www.altera.com.cn/ip。
供貨信息
目前以公司MegaCore函數IP庫的形式提供Altera同類(lèi)最佳的IP內核??蛻?hù)現在可以通過(guò)下載Quartus II軟件v13.1來(lái)使用IP庫。關(guān)于A(yíng)ltera IP系列產(chǎn)品的詳細信息,請聯(lián)系您當地的Altera銷(xiāo)售代表,或者訪(fǎng)問(wèn)www.altera.com.cn/ip。
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